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Text File  |  1987-08-26  |  4KB  |  90 lines
  1. Title     5-Bit Down Counter
  2. Pattern   DCount.pds
  3. Revision  B
  4. Author    Bill Karkula
  5. Company   Monolithic Memories Inc., Sanat Clara, CA
  6. Date      8/1/86
  7.   
  8. CHIP DN_COUNTER PAL20RA10
  9.   
  10. /PL D4 D3 D2 D1 D0 CK NC /LD /LR /RST GND
  11. /OE R0 R1 R2 R3 R4 Q0 Q1 Q2 Q3 Q4 VCC
  12.   
  13. EQUATIONS
  14.   
  15. /Q4             := Q4                   ;Toggle if lower MSB
  16. Q4.CLKF          = Q3                   ;becomes a one
  17. Q4.SETF          = RST                  ;Rollover/master RST
  18. Q4.RSTF          = /D4*LD               ;Load initial count
  19.   
  20. /Q3             := Q3                   ;Toggle when Q2
  21. Q3.CLKF          = Q2                   ;Becomes a one
  22. Q3.SETF          = RST                  ;Rollover/master RST
  23. Q3.RSTF          = /D3*LD               ;Load initial count
  24.   
  25. /Q2             := Q2                   ;Toggle when Q1
  26. Q2.CLKF          = Q1                   ;becomes a one
  27. Q2.SETF          = RST                  ;Rollover/master RST
  28. Q2.RSTF          = /D2*LD               ;Load initial count
  29.   
  30. /Q1             := Q1                   ;Toggle when Q0
  31. Q1.CLKF          = Q0                   ;becomes a one
  32. Q1.SETF          = RST                  ;Rollover/master RST
  33. Q1.RSTF          = /D1*LD               ;Load initial count
  34.   
  35. /Q0             := Q0                   ;Toggle  LSB
  36. Q0.CLKF          = CK                   ;External clock input
  37. Q0.SETF          = RST                  ;Rollover/master RST
  38. Q0.RSTF          = /D0*LD               ;Load initial count
  39.   
  40. /R4             := /D4                  ;Load rollover point
  41. R4.CLKF          = LR                   ;if /LR is low
  42. /R3             := /D3                  ;Load rollover bit 3
  43. R3.CLKF          = LR                   ;if /LR is asserted
  44. /R2             := /D2                  ;Load rollover bit 2
  45. R2.CLKF          = LR                   ;if /LR is asserted
  46. /R1             := /D1                  ;Load rollover bit 1
  47. R1.CLKF          = LR                   ;if /LR is asserted
  48. /R0             := /D0                  ;Load rollover bit 0
  49. R0.CLKF          = LR                   ;if /LR is asserted
  50.   
  51. SIMULATION
  52.   
  53. TRACE_ON PL OE CK Q0 Q1 Q2 Q3 Q4
  54.   
  55. SETF /PL OE /RST /CK /LD /LR
  56.   
  57. SETF RST LR CK D4 D3 D2 D1 D0           ;Test SET function of registers
  58.   
  59. CHECK /Q0 /Q1 /Q2 /Q3 /Q4               ;Check for high on
  60.                                         ;register outputs
  61. SETF /RST                               ;Deassert SET funct
  62. SETF /D0 /D1 /D2 /D3 /D4 LD             ;Test RESET funct.
  63. CHECK Q0 Q1 Q2 Q3 Q4
  64. SETF /OE /Q4 /Q3 /Q2 /Q1 Q0 /LD         ;Disable RESET, load
  65.                                         ;registers w/ LLLLH,
  66.                                         ;tristate registers
  67. SETF  PL                                ;Load regs w/ data
  68.                                         ;on output bus.
  69. SETF OE /PL                             ;Disable PRELOAD &
  70.                                         ;TRISTATE function.
  71. FOR I:=1 TO 7 DO                        ;Initially load regs
  72.  BEGIN                                  ;w/ LLLLH & clocked
  73.   SETF CK                               ;7 times.
  74.   SETF /CK                              ;Rollover at I=2
  75.   IF I=2 THEN                           ;count goes LLLLL
  76.    BEGIN                                ;to HHHHH.
  77.     CHECK /Q4 /Q3 /Q2 /Q1 /Q0           ;Check rollover pt.
  78.    END
  79.   IF I=6 THEN
  80.    BEGIN
  81.     CHECK Q4 Q3 Q2 /Q1 /Q0
  82.    END
  83.   IF I=7 THEN
  84.    BEGIN
  85.     CHECK Q4 Q3 /Q2 Q1 Q0
  86.    END
  87.   END
  88. TRACE_OFF
  89.   
  90.