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/ NetNews Usenet Archive 1992 #26 / NN_1992_26.iso / spool / comp / sys / acorn / tech / 633 < prev    next >
Encoding:
Internet Message Format  |  1992-11-13  |  1.3 KB

  1. Path: sparky!uunet!charon.amdahl.com!pacbell.com!decwrl!elroy.jpl.nasa.gov!usc!zaphod.mps.ohio-state.edu!magnus.acs.ohio-state.edu!usenet.ins.cwru.edu!agate!doc.ic.ac.uk!uknet!qmw-dcs!usenet
  2. From: rabin@cs.qmw.ac.uk (Rabin Ezra;PhD;E200)
  3. Newsgroups: comp.sys.acorn.tech
  4. Subject: Re: ARMXX & MHz
  5. Message-ID: <1992Nov13.162740.25352@dcs.qmw.ac.uk>
  6. Date: 13 Nov 92 16:27:40 GMT
  7. References: <BxntqI.1Io@brunel.ac.uk>
  8. Sender: usenet@dcs.qmw.ac.uk (Usenet News System)
  9. Organization: Computer Science Dept, QMW, University of London
  10. Lines: 12
  11. Nntp-Posting-Host: magician.dcs.qmw.ac.uk
  12.  
  13. I suspect that these are for programs that don't break cache too much. With
  14. the ARM2, the memory system keeps up reasonably well. With the ARM3 the cache
  15. helps to hide the effects of slow memory, though as soon as the cache breaks
  16. the performance drops to that of an ARM2, or slightly worse. The ARM600 gains
  17. a write back buffer which decouples the core from memory even more, but again
  18. if you have massive inline code you can slow the processor right down.
  19.        Rabin Ezra
  20. -- 
  21. Rabin Ezra, PhD Student                         Internet: rabin@dcs.qmw.ac.uk
  22. Dept of Computer Science,                       UUCP:  rabin@qmw-dcs.UUCP
  23. Queen Mary and Westfield College,               JANET: rabin@uk.ac.qmw.dcs
  24. Mile End Road, London E1 4NS, G.B.
  25.