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/ NetNews Usenet Archive 1992 #20 / NN_1992_20.iso / spool / comp / sys / mac / hardware / 17073 < prev    next >
Encoding:
Internet Message Format  |  1992-09-15  |  2.5 KB

  1. Path: sparky!uunet!paladin.american.edu!darwin.sura.net!wupost!sdd.hp.com!swrinde!elroy.jpl.nasa.gov!ames!data.nas.nasa.gov!taligent!apple!minow
  2. From: minow@Apple.COM (Martin Minow)
  3. Newsgroups: comp.sys.mac.hardware
  4. Subject: Re: ***** HELP ***** MACINTOSH W/ CACHE ****
  5. Message-ID: <72395@apple.Apple.COM>
  6. Date: 15 Sep 92 16:34:18 GMT
  7. References: <9209141803.AA21935@kiwi.tropix.uucp>
  8. Organization: Apple Computer Inc., Cupertino, CA
  9. Lines: 42
  10.  
  11. In article <9209141803.AA21935@kiwi.tropix.uucp> bng@tropel.gca.com
  12. (Baldwin Ng) writes:
  13. >What is "CACHE" or "CACHE CARD"?
  14. >How will a Macintosh computer's performance differ if
  15. >there is a CACHE CARD?
  16.  
  17. A cache or cache card is a hardware extension to the processor that allows
  18. the cpu and memory to run at different speeds. There are several types
  19. of caches. Take an instruction cache for example. Suppose the cpu wants
  20. to execute the instruction at memory address 123. The cache hardware
  21. first looks in its internal (very fast) memory for that memory value.
  22. If it's present, it delivers the value to the processor. If not, it reads
  23. main memory locations 123, 124, 125, and 126 [for example], delivers
  24. the value at 123 to the processor and remembers (i.e., caches) the others.
  25. Since it is very likely that the next instruction the processor will execute
  26. is at location 124, and the value of 124 will still be in the cache, the
  27. processor + cache combination eliminates a comparitively slow access
  28. to main memory.
  29.  
  30. Caches can operate similarly for data, and for memory writes. Writing
  31. data is a bit tricky, however, since the processor may write word 123
  32. then immediately read word 123. Here, the cache must deliver the latest
  33. value of that word, and not an out-of-date value that might be left
  34. in the cache.
  35.  
  36. Caches gain some performance by knowing that instruction accesses are
  37. supposed to be read-only, so it can bypass write-checks for instructions.
  38. This is a problem for programs that dynamically modify the instruction
  39. stream. If a program must do this, the program must explicitly inform
  40. the cache by executing a "cache flush" instruction. (There are similar
  41. problems for concurrent I/O operations.)
  42.  
  43. Caches may be built into the cpu hardware or available as add-on boards.
  44. There is a noticable performance improvement for cpu-bound tasks (I recently
  45. added a cache board to my Mac-IIci), but your experience will depend
  46. on the kind of programs you run.
  47.  
  48. Of course, the above explanation has simplified matters considerably; you
  49. should read a computer architecture textbook for more information.
  50.  
  51. Martin Minow
  52. minow@apple.com
  53.