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/ Liren Large Software Subsidy 15 / 15.iso / s / s205 / 1.ddi / BACKUP.001 / EXAMPLES_CB_SAMPLES_LA_C2.PDS < prev    next >
Encoding:
PALASM Design Description  |  1991-02-27  |  3.4 KB  |  117 lines
  1. ;PALASM Design Description
  2.  
  3. ;---------------------------------- Declaration Segment ------------
  4. TITLE    Logic Analyzer States
  5. PATTERN  
  6. REVISION 
  7. AUTHOR   john davis
  8. COMPANY  SIVAD for AMD
  9. DATE     10/15/90
  10.  
  11. CHIP  _la_state  MACH110
  12.  
  13. ;---------------------------------- PIN Declarations ---------------
  14. PIN  ?  /POR    COMBINATORIAL            ; Power On Reset
  15. NODE 1 POR_INIT
  16. PIN  35 CLK1                            ; Default Clock on pin 35
  17. PIN  ?  K_CLK COMBINATORIAL             ; 
  18.  
  19. PIN  ?  MSW[0] REGISTERED                 ; 
  20. PIN  ?  MSW[1] REGISTERED                 ; 
  21. PIN  ?  MSW[2] REGISTERED                 ; 
  22. PIN  ?  MSW[3] REGISTERED                 ; 
  23. PIN  ?  MSW[4] REGISTERED                 ; 
  24. PIN  ?  MSW[5] REGISTERED                 ; 
  25. PIN  ?  MSW[6] REGISTERED                 ; 
  26. PIN  ?  MSW[7] REGISTERED                 ; 
  27. PIN  ?  MSW[8] REGISTERED                 ; 
  28. PIN  ?  MSW[9] REGISTERED                 ; 
  29. PIN  ?  MSW[10] REGISTERED                ; 
  30. PIN  ?  MSW[11] REGISTERED                ; 
  31. PIN  ?  MSW[13] REGISTERED                ; 
  32. PIN  ?  MSW[14] REGISTERED                ; 
  33. PIN  ?  MSW[15] REGISTERED                ; 
  34. PIN  ?  ACK    REGISTERED                 ; 
  35. PIN  ?  HIT    COMBINATORIAL              ; 
  36.  
  37. PIN ?  K0 REGISTERED                   ; 
  38. PIN ?  K1 REGISTERED                   ; 
  39. PIN ?  K2 REGISTERED                   ; 
  40. PIN ?  K3 REGISTERED                   ; 
  41. ;NODE ?  K0 REGISTERED                   ; 
  42. ;NODE ?  K1 REGISTERED                   ; 
  43. ;NODE ?  K2 REGISTERED                   ; 
  44. ;NODE ?  K3 REGISTERED                   ; 
  45. NODE ?  K_C0_0 REGISTERED                 ; 
  46. NODE ?  K_C0_1 REGISTERED                 ; 
  47. NODE ?  K_C1   REGISTERED                 ; 
  48. NODE ?  K_C2_0 REGISTERED                 ; 
  49. NODE ?  K_C2_1 REGISTERED                 ; 
  50. NODE ?  K_C3 REGISTERED                   ; 
  51. NODE ?  K_C4 REGISTERED                   ; 
  52.  
  53. ;STRING DECLARATIONS.
  54. STRING GL '(MSW[0])'
  55. STRING DL '(MSW[1])'
  56. STRING BF '(MSW[2])'
  57. STRING TR0 'MSW[3]'
  58. STRING TR1 'MSW[4]'
  59. STRING TR2 'MSW[5]'
  60. STRING ST '(MSW[6])'
  61. STRING XCK '(MSW[7])'
  62. STRING TG '(MSW[8])'
  63. STRING SM '(MSW[9])'
  64. STRING XS '(MSW[10])'
  65. STRING CS '(MSW[11])'
  66. STRING EQ '(MSW[12])'
  67. STRING TA '(MSW[13])'
  68. STRING TD '(MSW[14])'
  69.  
  70. STRING S_K0  '/K3*/K2*/K1*/K0'        ;Main Control State Bits
  71. STRING S_K1  '/K3*/K2*/K1* K0'
  72. STRING S_K2  '/K3*/K2* K1*/K0'
  73. STRING S_K3  '/K3*/K2* K1* K0'
  74. STRING S_K4  '/K3* K2*/K1*/K0'
  75. STRING S_K5  '/K3* K2*/K1* K0'
  76. STRING S_K6  '/K3* K2* K1*/K0'
  77. STRING S_K7  '/K3* K2* K1* K0'
  78. STRING S_K8  ' K3*/K2*/K1*/K0'
  79.  
  80. STRING S_TDD    '/TR2*/TR1*/TR0'        ;Operational Mode Bits
  81. STRING S_TTD    '/TR2*/TR1* TR0'
  82. STRING S_TAD    '/TR2* TR1*/TR0'
  83. STRING S_TBD     '/TR2* TR1* TR0'
  84. STRING S_LD_RG     ' TR2*/TR1*/TR0'
  85. STRING S_LD_AT     ' TR2*/TR1* TR0'
  86. STRING S_LSA     '(S_TDD+S_TTD+S_TAD+S_TBD)'
  87. STRING S_SET     '(S_LD_RG+S_LD_AT)'
  88.  
  89. ;----------------------------------- Boolean Equation Segment ------
  90. EQUATIONS
  91.  
  92. STATE
  93.  
  94. M_C2_0  = /K_C2_1*/K_C2_0    ;C2 Control State Definition
  95. M_C2_1  = /K_C2_1* K_C2_0
  96. M_C2_2  =  K_C2_1*/K_C2_0
  97.  
  98.  
  99. MOORE_MACHINE            ;Trace State Machine
  100.  
  101. M_C2_0 := TRACE -> M_C2_1
  102.         +-> M_C2_0;
  103.  
  104. M_C2_1 := TRACE -> M_C2_2
  105.         +-> M_C2_0;
  106.  
  107. M_C2_2 := TRACE -> M_C2_0;
  108.         +-> M_C2_0;
  109.  
  110. ;---------------------------- CONDITIONs Sub Segment ------------
  111.  
  112. CONDITIONS
  113.  
  114. TRACE =     S_LSA*(S_TDD*S_K3 + S_TTD*S_K2 + S_TAD*S_K3 + S_TBD*S_K3)
  115.  
  116.  
  117.