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/ NetNews Usenet Archive 1992 #20 / NN_1992_20.iso / spool / comp / sys / next / hardware / 1620 < prev    next >
Encoding:
Internet Message Format  |  1992-09-08  |  2.5 KB
  1. Path: sparky!uunet!olivea!sgigate!odin!sgihub!zola!zuni!anchor!olson
  2. From: olson@anchor.esd.sgi.com (Dave Olson)
  3. Newsgroups: comp.sys.next.hardware
  4. Subject: Re: Terrible SCSI Transfer
  5. Message-ID: <ph5rpmo@zuni.esd.sgi.com>
  6. Date: 6 Sep 92 20:22:10 GMT
  7. References: <1992Sep1.010514.432@leland.Stanford.EDU> <Bu5vq5.3wF@iat.holonet.net>
  8. Sender: news@zuni.esd.sgi.com (Net News)
  9. Distribution: usa
  10. Organization: Silicon Graphics, Inc.  Mountain View, CA
  11. Lines: 44
  12.  
  13. In <Bu5vq5.3wF@iat.holonet.net> bwilliam@iat.holonet.net (Bill Williams) writes:
  14. | > These generate a lot of interrupts for each SCSI transaction 
  15. | 
  16. | I Believe that NO COMPUTER could efficiently use individual interrupts
  17. | during the data tranfer phase of a SCSI transaction. For example, though
  18. | using an interrupt driven buffer for ASYNCHRONOUS I/O might sound like a
  19. | good idea, it is much more likely that trying to get a NeXT or a Mac
  20. | Quadra 950 to handle over three million interrupts per second would
  21. | be ludicrous.
  22.  
  23. Nobody is talking about interrupts *per byte*.  They were talking
  24. about interrupts *per SCSI bus phase change* (and actually, not
  25. even every change, just the ones that the various chips don't
  26. handle).
  27.  
  28. | Therefore what the computers probably REALLY do is POLL.
  29.  
  30. No, they mostly use DMA ('real' computers, anyway).
  31.  
  32. | Polling does indeed tie up the CPU dramatically on computers that use the
  33. | primary system CPU to perform the polling of the SCSI interface chip 
  34. | directly (for each byte)... I don't think NeXT computers even do that.
  35. | For example, I think the DMA services on the NeXT with the "Generic" 
  36. | user accessable SCSI Driver (Slow) do not use the system CPU to POLL.
  37.  
  38. I'd be astounded if they did.
  39.  
  40. | I am assuming that in my definition of usage asynchronous, narrow (8
  41. | bit) data is being used. Obviously a NCR53720 with "fictional"
  42. | 32 bit wide synchronous data from an array server approaching
  43. | TWENTY MEG PER SECOND is a clear benefit of of a 720 chip.
  44.  
  45. The 720 only supports 16 bit wide SCSI, but will (at least in
  46. bursts, and depending on the devices, and the host interface,
  47. etc. etc. etc.) sustain 20 Mbytes/sec *in data phase* at least
  48. some of the time.
  49.  
  50. Clearly one has to issue commands etc., occasionally to do
  51. useful work, and then you run into command overhead on both
  52. the host and the target.
  53. --
  54. Let no one tell me that silence gives consent,  |   Dave Olson
  55. because whoever is silent dissents.             |   Silicon Graphics, Inc.
  56.     Maria Isabel Barreno                        |   olson@sgi.com
  57.