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/ NetNews Usenet Archive 1992 #18 / NN_1992_18.iso / spool / comp / dsp / 1938 < prev    next >
Encoding:
Internet Message Format  |  1992-08-13  |  2.5 KB
  1. Path: sparky!uunet!cs.utexas.edu!sun-barr!male.EBay.Sun.COM!exodus.Eng.Sun.COM!sun!amdcad!dvorak.amd.com!cayman!pteich
  2. From: pteich@cayman.amd.com (Paul Teich)
  3. Newsgroups: comp.dsp
  4. Subject: Re: I860 fft performance
  5. Message-ID: <1992Aug13.162158.1414@dvorak.amd.com>
  6. Date: 13 Aug 92 16:21:58 GMT
  7. References: <713099311.0@halluc.com> <1992Aug6.125445.10704@nntp.nta.no> <12948@inews.intel.com>
  8. Sender: usenet@dvorak.amd.com (Usenet News)
  9. Reply-To: pteich@cayman.amd.com (Paul Teich)
  10. Followup-To: comp.dsp
  11. Organization: Advanced Micro Devices, Austin, TX
  12. Lines: 38
  13.  
  14. In article <12948@inews.intel.com> rrao@pima.intel.com (Ravi Rao) writes:
  15. | In article <1992Aug6.125445.10704@nntp.nta.no> hlj@hal.nta.no writes:
  16. | >
  17. | >If the following two conditions are met:
  18. | >
  19. | >    1. All your data occupies less than 8 kbytes (such that all data
  20. | >       is in the cache or in registers)
  21. |         Obviously, you don't know about the existence of the nex-gen
  22. |         860 which has 16K of data/instr cache. There are some other
  23. |         instr enhancements like 'pfld.q' to make use of full b/w.
  24.     Hmmm, seems like DSPs or RISC uPs which can efficiently access external
  25.     memory (low access latencies and burst modes, >1 i/o bus for DSPs)
  26.     would have an advantage over large *expensive* on-chip caches.  Just
  27.     how expensive is this new gen 860? ;v)
  28.  
  29. | >    2. Your algorithm is such that it can be implemented in i860
  30. | >       pipelined mode (which is awkward to program)
  31. |         To get peak performance, you have to program most uP in 
  32. |         assembly language. There is no doubt that the i860 pipeline
  33. |         is hard to follow, but once you get the hang of it, its fairly
  34. |         easy..............
  35.     860 programs must be hand-coded to get anywhere near stated
  36.     performance.  Most RISC processors (the 860 is a VLIW uP, *not* RISC)
  37.     perform quite well using compiled C.  For DSP, RISC can be easily hand
  38.     programmed - the superscalar varieties even do the scheduling (with
  39.     small scale optimizations) for you (unlike the 860).
  40.  
  41. Disclaimer:  I speak for myself and no one else - hell, I don't even work with
  42. the Am29050 floating point RISC microprocessor any more.
  43. --
  44. Paul R. Teich                          pteich@cayman.AMD.COM
  45. Advanced Micro Devices, Inc.           Direct 1-512-462-4268
  46. 5900 E. Ben White Blvd., MS 561        WATS   1-800-538-8450 x54268
  47. Austin, Texas  78741                   FAX    1-512-462-4756
  48. ===============================================================================
  49. Well do you ever get to feeling
  50.     That the story's too damn real
  51.         And in the present tense?        I. Anderson
  52.