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/ NetNews Usenet Archive 1992 #18 / NN_1992_18.iso / spool / comp / arch / 8889 < prev    next >
Encoding:
Internet Message Format  |  1992-08-13  |  1.4 KB
  1. Path: sparky!uunet!stanford.edu!agate!krste
  2. From: krste@ICSI.Berkeley.EDU (Krste Asanovic)
  3. Newsgroups: comp.arch
  4. Subject: Die aspect ratio.
  5. Date: 13 Aug 1992 19:42:38 GMT
  6. Organization: International Computer Science Institute, Berkeley, CA, U.S.A.
  7. Lines: 24
  8. Distribution: world
  9. Message-ID: <16edveINN7or@agate.berkeley.edu>
  10. NNTP-Posting-Host: icsib43.icsi.berkeley.edu
  11.  
  12.  
  13. I've a few questions for the VLSI hackers out in industry.
  14.  
  15. Sun in particular with the Viking, the cache controller, and the
  16. SPARC90, have produced many exactly square die recently. Also, there
  17. were quite a few other chips at this year's Hot Chips that were
  18. exactly square (or at least to the nearest 0.1mm).
  19.  
  20. It seems unlikely that an irregular design such as a processor or
  21. cache controller would map naturally to a square die floorplan.  Is
  22. there some inherent yield or manufacturability advantage to having a
  23. square die?  I can think of reticle size and maybe efficient wafer
  24. tiling as two reasons.
  25.  
  26. Rectangular die give more perimeter per unit area if a design is pad
  27. limited. What's the largest sensible/known aspect ratio? (We've done
  28. one processor die with an aspect ratio of 2.3:1).
  29.  
  30. Thanks.
  31. -- 
  32. Krste Asanovic,                 Computer Science Division, 
  33. email: krste@cs.berkeley.edu    571 Evans Hall
  34. phone: +1 (510) 643-8733        University of California at Berkeley
  35. fax:   +1 (510) 643-7684        CA 94720, USA
  36.