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Text File  |  1991-02-28  |  2.6 KB  |  83 lines
  1. ≡
  2. .PRLD
  3. Overview
  4. This is the reserved word in a functional equation that defines the
  5. conditions when the preload function is activated in devices with
  6. logic-controlled preload.  When the .PRLD equation is true, you can
  7. preload flip-flops to the desired value from the corresponding I/O
  8. pin.
  9.  
  10.  
  11. Syntax──────────────────────────────────────────────────────────────
  12.  
  13.             Node.PRLD    Assignment Operator    Expression
  14. ────────────────────────────────────────────────────────────────────
  15.  
  16. Device Support:   PALCE29M16    PALCE29MA16
  17. ·
  18. Syntax
  19. Use the .PRLD functional equation in the equations segment of Boolean
  20. designs.
  21.  
  22. Syntax──────────────────────────────────────────────────────────────
  23.  
  24.             Node.PRLD    Assignment Operator    Expression
  25.  
  26. Example─────────────────────────────────────────────────────────────
  27.  
  28.      EQUATIONS
  29.               Q0                =                  /Q0
  30.               GLO.PRLD          =                   Q0 * /Q1
  31.               ...
  32. ────────────────────────────────────────────────────────────────────
  33. ·
  34. Definitions
  35.  
  36. Node.PRLD       Identifies the node associated with the register you
  37.                 want to preload. On the PALCE29M16, this is the global
  38.                 node.
  39.  
  40. Assignment Operator    A symbol that defines a specific operation as
  41.                        interpreted by the software when processing
  42.                        design files.
  43.  
  44.  
  45. Expression      Identifies logic you assign to define the conditions
  46.                 when the preload function is activated.
  47.  
  48. ·
  49. Use
  50. You can place the .PRLD equation anywhere in the equations segment.
  51. The .PRLD equation may fit on more than one product term, depending on
  52. the device.  The following rules apply.
  53.  
  54. ■    Do not use multiple functional equations for the same pin or
  55.      node. Otherwise, an error is reported during
  56.      compilation and the processing is halted.
  57.  
  58. ■    Do not use negative polarity on the left-hand side of the
  59.      equation.  For example, /Q1.PRLD is illegal.
  60.  
  61. Logic preloads use SETF and the pin polarity defined in the pin 
  62. declaration segment to determine preload polarity. 
  63.  
  64. Note:  Super voltage preloads evaluate a complemented pin, /A, as
  65.        preload low.  If there is no complement, then it is a preload
  66.        high.
  67.  
  68. ■    Disable any product term enables when .PRLD is low.
  69.  
  70. In simulation, the SETF command to asserts the product term defined by 
  71. .PRLD to determine the preload values.   
  72.  
  73. In the simulation history file, .PRLD is represented by the letter P, 
  74. SETF by the letter H and .RSTF by the letter L.
  75. ·
  76. Related Topics
  77. Boolean Equation
  78. EXPRESSION
  79. Functional Equation
  80. PRELOAD
  81. SETF
  82. ·
  83.