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/ NetNews Usenet Archive 1992 #31 / NN_1992_31.iso / spool / comp / sys / amiga / hardware / 22046 < prev    next >
Encoding:
Internet Message Format  |  1992-12-24  |  2.7 KB
  1. Path: sparky!uunet!gatech!paladin.american.edu!howland.reston.ans.net!wupost!spool.mu.edu!umn.edu!msus1.msus.edu!msus1.msus.edu!news
  2. Newsgroups: comp.sys.amiga.hardware
  3. Subject: Re: Data/Instruction Cache & BURST modes on 68030? Why/when?
  4. Message-ID: <1992Dec24.121546.1956@msus1.msus.edu>
  5. From: lkoop@TIGGER.STCLOUD.MSUS.EDU (LaMonte Koop)
  6. Date: 24 Dec 92 12:15:45 -0600
  7. Reply-To: lkoop@TIGGER.STCLOUD.MSUS.EDU
  8. References: <hellerS.724958427@batman> <72192@cup.portal.com><1992Dec22.212901.860@samba.oit.unc.edu>,<72290@cup.portal.com>
  9. Organization: SCS GP/Engineering Cluster
  10. Nntp-Posting-Host: tigger.stcloud.msus.edu
  11. Lines: 38
  12.  
  13. In article <72290@cup.portal.com>, Tony-Preston@cup.portal.com (ANTHONY FRANCIS PRESTON) writes:
  14. >|>You should leave the setting  alone!  A small tutorial is in order!
  15. >|>SetPatch will setup the system correctly so that the caches and burst
  16. >|>are correct for the Amiga. 
  17. >|> 
  18. >|>several long words of data.  This happens faster than if each long
  19. >|>word was a separate access.  This pre-loads the cache and allows you
  20. >|>to get extra 'hits' on the instruction cache(or data cache).  There
  21. >|>are times(code that branches) where this might slow down the cpu, but
  22. >|>in general it wil speed it up slightly.
  23. >|> 
  24. >|>The 68020 has a single cache for data and instructions, the 68030
  25. >|>has separate ones.  The cache size in this case is 256 bytes.  The
  26. >|>68040 has 4096 byte caches for instruction and for data.
  27. >|> 
  28. >|>There are no such things as stupid, dumb, or ignorant questions, just
  29. >|>stupid, dumb, or ignorant people that will not ask questions.
  30. >|
  31. >|Thanks a lot for this info.  I have always known about the cache and when
  32. >|I use sysinfo it says data cache off so I put a command in my SS to turn
  33. >|it on thinking I was missing something.  I guess I'll turn it off.  Since
  34. >
  35. >  If you turn on the data cache, you run the risk of crashes if the chipe
  36. >  memory is data cached.  This is due to the custom co-processors accessing
  37. >  the chip memory and changing location while the cpu has the data cached.
  38.  
  39. This is only on a badly designed system where cache management of such is not
  40. done in hardware.  The CSA MMR DOES properly do this, so the data cache is
  41. not a problem in this respect, and should be used, and can be used when
  42. desired.  The only setup I am aware of which had the problem of inproper cache
  43. managment of cacheable address spaces is the older Ronin Hurricane accelerators
  44. (the 68030 versions).
  45.  
  46.                  ----------------------------------------
  47.            LaMonte Koop -- SCSU Electrical/Computer Engineering
  48.  Internet: lkoop@tigger.stcloud.msus.edu -OR- f00012@kanga.stcloud.msus.edu
  49.               "You mean you want MORE lights on this thing???"
  50.  ---------------------------------------------------------------------------
  51.