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/ NetNews Usenet Archive 1992 #31 / NN_1992_31.iso / spool / comp / arch / 12018 < prev    next >
Encoding:
Text File  |  1992-12-31  |  1.6 KB  |  43 lines
  1. Newsgroups: comp.arch
  2. Path: sparky!uunet!spool.mu.edu!agate!stanford.edu!enterpoop.mit.edu!eff!ssd.intel.com!ichips!ichips!glew
  3. From: glew@pdx007.intel.com (Andy Glew)
  4. Subject: Re: branch-and-link
  5. In-Reply-To: dswartz@sw.stratus.com's message of 27 Dec 92 17:54:11 GMT
  6. Message-ID: <GLEW.92Dec31162920@pdx007.intel.com>
  7. Sender: news@ichips.intel.com (News Account)
  8. Organization: Intel Corp., Hillsboro, Oregon
  9. References: <1hkqk3INNsns@transfer.stratus.com>
  10. Date: Fri, 1 Jan 1993 00:29:20 GMT
  11. Lines: 30
  12.  
  13.     Here's a question for the hardware types: is there any reason either of
  14.     design complexity or performance to not have *all* branches (conditional
  15.     and unconditional) save their origin somewhere (probably in a fast
  16.     dedicated register)?  I know various cpu's (the rs6000?) have done this
  17.     in the past, but only as an option.  If there is no negative impact to
  18.     doing this, it would be a real win for debugging crashes where a program
  19.     (application or kernel) branch off to nowhere and die - and the poor S/W
  20.     type is left guessing...
  21.  
  22. Make it an option, specific to a model.
  23.  
  24. Some microarchitectures can do it easily.
  25.  
  26. Other, quite reasonable, microarchitectures can't do it at all without
  27. slowing down (or requiring a PC to be attached to every instruction as
  28. it flows through the pipe).
  29.  
  30. When you can do it, great! But don't slow down other implementations
  31. for a debug feature that is not in use most of the time.
  32.  
  33. --
  34.  
  35. Andy Glew, glew@ichips.intel.com
  36. Intel Corp., M/S JF1-19, 5200 NE Elam Young Pkwy, 
  37. Hillsboro, Oregon 97124-6497
  38.  
  39. This is a private posting; it does not indicate opinions or positions
  40. of Intel Corp.
  41.  
  42. Intel Inside (tm)
  43.