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/ NetNews Usenet Archive 1992 #16 / NN_1992_16.iso / spool / comp / arch / 8179 < prev    next >
Encoding:
Internet Message Format  |  1992-07-21  |  2.5 KB
  1. Path: sparky!uunet!noc.near.net!nic.umass.edu!dime!dime.cs.umass.edu!moss
  2. From: moss@cs.umass.edu (Eliot Moss)
  3. Newsgroups: comp.arch
  4. Subject: Re: SuperSPARC doesn't need superscalar compiler?!
  5. Message-ID: <MOSS.92Jul21091941@ibis.cs.umass.edu>
  6. Date: 21 Jul 92 13:19:41 GMT
  7. References: <9207201142.AA04083@x1sun6.ccl.itri.org.tw>
  8. Sender: news@dime.cs.umass.edu
  9. Reply-To: moss@cs.umass.edu
  10. Organization: Dept of Comp and Info Sci, Univ of Mass (Amherst)
  11. Lines: 38
  12. In-reply-to: lycmit@X1SUN6.CCL.ITRI.ORG.TW's message of 21 Jul 92 01:42:07 GMT
  13.  
  14. >>>>> On 21 Jul 92 01:42:07 GMT, lycmit@X1SUN6.CCL.ITRI.ORG.TW (Yin-Chih Lin)
  15. >>>>> said:
  16.  
  17. Yin-Chih> ... one of the Sun Micro employees had adverted that the SuperSPARC
  18. Yin-Chih> (superscalar SPARC which can issue 3 intructions at max performance)
  19. Yin-Chih> does not require the superscalar compiler to obtain the best CPU
  20. Yin-Chih> performance.
  21.  
  22. It could be that compilation principles followed for other models of SPARC
  23. will indeed yield good results for this implementation, too. For example,
  24. there is the load delay of two cycles, which would cause instruction
  25. schedulers to space loads and succeeding uses at least three instructions
  26. apart, so they would fall into separate windows for issue on the SuperSPARC.
  27. That is, a non-superscalar might require spacing things out in time,
  28. especially for non-fully-pipelined functional units. This spacing will tend to
  29. help on a superscalar with a limited number of functional units. It's a
  30. transformation between time and space, but there are significant similarities.
  31.  
  32. Of course, you are right that in general a good schedule for a non-superscalar
  33. may not be the best schedule for a superscalar that does not have enough
  34. resources available on each cycle. For example, a non-superscalar might be
  35. able to issue one register to register multiply every cycle, given one fully
  36. pipelined multiplier. A superscalar that issues N instructions per cycle would
  37. need N fully pipeined units to guarantee not to stall, but most code probbaly
  38. does not need N fully pipelined multipliers.
  39.  
  40. However, the designers of the Motorola 88110 did do some balancing analysis
  41. and decided to replicate some functional units. It's a dual issue machine, and
  42. some kinds of instructions are popular enough that it pays to be able to issue
  43. two in the same cycle, which requires two similar functional units.
  44. --
  45.  
  46.         J. Eliot B. Moss, Associate Professor
  47.         Department of Computer Science
  48.         Lederle Graduate Research Center
  49.         University of Massachusetts
  50.         Amherst, MA  01003
  51.         (413) 545-4206, 545-1249 (fax); Moss@cs.umass.edu
  52.