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Text File  |  1993-11-09  |  1.1 KB  |  30 lines
  1. !Documentation
  2.  
  3.     (c) Copyright 1982 Genashor Corp.  All Rights Reserved.
  4.  
  5.     This circuit demonstrates the ability of SIMIC to properly handle
  6.     the merging of electrical attributes at wireties.  This circuit
  7.     consists of two tristate drivers on a bus with an active bus hold
  8.     circuit used to retain the last driven value.  All other known
  9.     gate simulators incorrectly predict the final state of the bus
  10.     using the stimulus described in the SIMIC run file, BUSHOLD.RUN.
  11.  
  12. !Delay
  13. !Format    Delay=    Change=
  14.     C= Global delays specified as delay vs. loading curves in
  15.     C= [<intercept>,<slope>] format.
  16.     Del10    [0,10]
  17.     Del100    [0,100]
  18. !Logical
  19. !Format    Part=    Type=    I=        O=    Odel=
  20. Type=bushold I=EnA,DataA,EnB,DataB O=E Olod=1
  21.     C= These are the bus driving devices:
  22.     u1    tpadn    EnA,DataA    Bus    Del10
  23.     u2    tpadn    EnB,DataB    Bus    Del10
  24.     C= This is the Bus Hold circuit (Two small geometry inverters) :
  25.     u3    inv    Bus        NBus    Del10    ODrive=resistive
  26.     u4    inv    NBus        Bus    Del100    ODrive=resistive $
  27.         Ilod=1
  28.     C= This is a receiving device off the bus (which adds 1 pF loading)
  29.     u5    and    Bus        E    Del10 Ilod=1
  30.