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Text File  |  1991-07-14  |  2.2 KB  |  64 lines
  1. Authors Notes:-
  2.  
  3.  1) Instructions timings are accurate to within:
  4.  
  5.                  4 * MCLK
  6.                  --------   
  7.                      i
  8.  
  9.           where 
  10.                i    is the number of instructions tested
  11.                MCLK is the system clock (125 nS on an 8 MHz machine)
  12.  
  13.     ARM instructions are therfore calculated to within 2 nS +- 2%
  14.  2) ARM Speed in MIPS is calculated as the average number of each
  15.     instruction Group in a test sample of 1000 instructions
  16.  3) IOC and VIDC types remain Unknown at present
  17.  4) Checks are made for all processors known to date. ie. ARM 1,2 and 3
  18.  5) Interrupts and DMA requests are stopped whilst calculations are
  19.     taking place
  20.  6) Looped instructions are calculated as one instruction of the specific
  21.     Group + one Group 1 + one group 4 instruction
  22.  7) Instruction timings are calculated during Video Flyback, and are
  23.     therefore dependant on the Video Flyback period and DRAM refresh
  24.     (large modes with no vertical boarders will affect results)
  25.  8) Group 1a results on ARM 2's do not take account of the hardware bug
  26.     (instructions take 24 S cycles rather than the maximum of 16)
  27.  9) Instruction indexes are relative to a perfect ARM 2 running at 8 MHz
  28. 10) FPU instruction speeds are calculated by either 3, 16 or 80
  29.     instructions depending upon the instruction in question.  
  30. 11) FPU instructions are calculated to within 167 nS, 31 nS or 6 ns +- 2%
  31.     dependent upon the instruction
  32. 11) FPU indexes include both register values and immediate values in the
  33.     form #1.0
  34. 12) FPU speed in FLOPS is calculated as the total number of instructions
  35.     divided by the time taken, this does not take account of common
  36.     instructions
  37. 13) All FPU calculations with the exception of STF and LDF are done in
  38.     extended precision.  STF and LDF are packed decimal precision
  39.  
  40.  
  41.  
  42.  
  43. Modifications to v1.00
  44.   - Group 4 index
  45.   - Looped instruction indexes
  46.  
  47. Modifications to v2.00
  48.   - FPU indexes
  49.  
  50. Modifications to v3.00
  51.   - Improved icon updating
  52.  
  53. Modifications to v3.04
  54.   - Check FPU/FPEmulator present
  55.  
  56. Modifications to v3.07
  57.   - Improved Group 4 looped instruction index
  58.   - Improved FPU instruction timings
  59.  
  60. Modifications to v3.09
  61.   - Improved window handling
  62.   - Modified bandwidth calculations for ARM 2 machines
  63.  
  64.