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/ CP/M / CPM_CDROM.iso / cpm / utils / asmutl / hd64180b.lbr / MOKEMAP.LZB / MOKEMAP.LIB
Encoding:
Text File  |  1991-08-04  |  3.0 KB  |  88 lines
  1. ;----------------------------------------------------------------
  2. ;    Port Equates for HD64B180 CPU
  3. ;
  4. ; This library is used to talk to ports in the CPU chip,
  5. ; and to off chip ports. ALL PORTS fella.
  6. ;
  7. ;    Written     by Richard Holmes    27-05-87
  8. ;    Last Update by Richard Holmes    17-03-89
  9. ;----------------------------------------------------------------
  10. ;
  11. base    equ    0        ; Base port address
  12. ;
  13. ; Async. Serical Communication Interface equstes
  14. ;
  15. cntla0    equ    base + 000h    ; ASCI Control register A ch 0
  16. cntla1    equ    base + 001h    ; ASCI Control register A ch 1
  17. cntlb0    equ    base + 002h    ; ASCI Control register B ch 0
  18. cntlb1    equ    base + 003h    ; ASCI Control register B ch 1
  19. stat0    equ    base + 004h    ; ASCI status register ch 0
  20. stat1    equ    base + 005h    ; ASCI status register ch 1
  21. tdr0    equ    base + 006h    ;      transmit data register ch 0
  22. tdr1    equ    base + 007h    ;      transmit data register ch 1
  23. rdr0    equ    base + 008h    ;      receive data register ch 0
  24. rdr1    equ    base + 009h    ;      receive data register ch 1
  25. ;
  26. ; Clocked Serial I/O Ports
  27. ;
  28. cntr    equ    base + 00ah    ; CSIO Control 
  29. trdr    equ    base + 00bh    ; CSIO transmit / receive data
  30. ;
  31. ; Timers ports
  32. ;
  33. tmdr0l    equ    base + 00ch    ; Timer data register ch 0 low
  34. tmdr0h    equ    base + 00dh    ; Timer data register ch 0 high
  35. rldr0l    equ    base + 00eh    ; Reload register ch 0 low
  36. rldr0h    equ    base + 00fh    ; Reload register ch 0 high
  37. tcr    equ    base + 010h    ; Timer control register
  38. ;
  39. tmdr1l    equ    base + 014h    ; Timer data register ch 1 low
  40. tmdr1h    equ    base + 015h    ; Timer data register ch 1 high
  41. rldr1l    equ    base + 016h    ; Reload register ch 1 low
  42. rldr1h    equ    base + 017h    ; Reload register ch 1 high
  43. ;
  44. ; DMA Channels.
  45. ;
  46. sar0l    equ    base + 020h    ; DMA Source address ch 0 low
  47. sar0h    equ    base + 021h    ; DMA Source address ch 0 high
  48. sar0b    equ    base + 022h    ; DMA Source address ch 0 B
  49. dar0l    equ    base + 023h    ; DMA Source address ch 1 low
  50. dar0h    equ    base + 024h    ; DMA Source address ch 1 high
  51. dar0b    equ    base + 025h    ; DMA Source address ch 1 B
  52. bcr0l    equ    base + 026h    ; DMA byte count ch 0 low
  53. bcr0h    equ    base + 027h    ; DMA byte count ch 0 low
  54. mra1l    equ    base + 028h    ; DMA memory addres reg. ch 1 low
  55. mra1h    equ    base + 029h    ; DMA memory addres reg. ch 1 high
  56. mra1b    equ    base + 02Ah    ; DMA memory addres reg. ch 1 B
  57. ;
  58. iar1l    equ    base + 02bh    ; DMA address reg. ch 1 low
  59. iar1h    equ    base + 02ch    ; DMA address reg. ch 1 high
  60. ;
  61. bcr1l    equ    base + 02eh    ; DMA byte count reg. 1 low
  62. bcr1h    equ    base + 02fh    ; DMA byte count reg. 1 high
  63. dstat    equ    base + 030h    ; DMA Status reg.
  64. dmode    equ    base + 031h    ; DMA Mode reg.
  65. dcntl    equ    base + 032h    ; DMA wait/control reg.
  66. ;
  67. ; Interrupt control ports.
  68. ;
  69. il    equ    base + 033h    ; IL register (Intrrupt vector reg)
  70. itc    equ    base + 034h    ; INT / TRAP control register
  71. rcr    equ    base + 036h    ; Refresh control register
  72. ;
  73. ; MMU 
  74. ;
  75. cbr    equ    base + 038h    ; MMU Common base register
  76. bbr    equ    base + 039h    ; MMU Bank base register
  77. cbar    equ    base + 03ah    ; MMU Commmmon/bank area register
  78. ;
  79. icr    equ    base + 03fh    ; I/O control register
  80. ;
  81. ; A library of hardware equates for the MOKE PCB
  82. ;
  83. wdt    equ    08Fh
  84. ;
  85. ;
  86. ; ---- End ----
  87. ;
  88.