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Text File  |  1993-08-27  |  3.2 KB  |  77 lines
  1.  
  2. Este procesador por seguir la tradición debería haberser
  3. llamado 586 pero para evitar que otras empresas como AMD
  4. o CYRIX puedan usar el mismo nombre, se le puso PENTIUM.
  5. Me explicare mejor.  Intel llevo a los tribunales a AMD por
  6. usar las siglas 386 en su procesador (por cierto, mejor que
  7. el de Intel) pero el juez decidio que no podía protegerse
  8. una cifra como marca.
  9.  
  10. Es un procesador impresionante, capaz de alcanzar 117 ▒MIPS▓
  11. a 66 MHz.  De momento se comercializan versiones a 60 y 66
  12. MHz pero en un futuro podrá alcanzar una velocidad de reloj
  13. de 100 MHz.
  14. Integra 3,1 millones de transistores, arquitectura
  15. superescalar, una unidad de coma flotante mejorada, memorias
  16. caché separadas para el código y los datos y un bus de datos
  17. externo de 64 bits.
  18.  
  19. Es un procesador RISC, si bien para guardar compatibilidad
  20. con la familia x86, se ha incluido dentro de su diseño una
  21. parte CISC, que aunque ha reducido su potencia, garantiza
  22. esa compatibilidad.
  23. Además en su parte CISC se inclullen más intrucciones que en
  24. el 486, que le permiten realizar una mejor geestion de la
  25. memoria y disponer de mayor caché.
  26.  
  27. Posee una doble unidad de instrucciones que le permite
  28. decodificarlas en paralelo (a la vez).
  29.  
  30. Su principal caracteristica es su concepción superescalar,
  31. basada en dos pipelines de instrucciones totalmente
  32. independientes, que le permiten ejecutar dos instrucciones en
  33. enteros en un solo ciclo de reloj mediante un proceso
  34. denominado "acoplamiento de instrucciones".  Cada pipeline
  35. posee su propia ALU, sus circuitos de generadores de
  36. direcciones y su interface para la memoria caché de datos.
  37.  
  38. Tiene 16 Kbytes de ▒caché▓, dividida en dos bancos de 8 Kbytes,
  39. una para datos y otra para instrucciones, organizada en
  40. lineas de 32 bits.
  41. A esta caché se le añade otra pequeña denominada Branch
  42. Target Buffer, que se encarga de recordar la dirección de
  43. ramificación empleada en una instrucción y que es utilizada
  44. para predecir el camino de la instrucción la próxima vez,
  45. ahorrando tiempo de busqueda de la ramificación.
  46.  
  47. La caché de datos posee dos interfaces, uno para cada
  48. pipeline.
  49.  
  50. En lugar de escribir los datos en la caché y la memoria
  51. principal al mismo tiempo utiliza la tecnica de "escritura
  52. diferida", en la que el dato no pasa a la memoria principal
  53. hasta que se suprime de la caché.
  54.  
  55. Para asegurar la coherencia entre los datos de la caché y la
  56. memoria principal, Pentium utiliza un protocolo denominado
  57. MESI, que define cuatro estados asignados a cada línea de
  58. caché sobre la base de las acciones realizadas sobre ellas
  59. por la unidad central.
  60.  
  61. Al usar un bus externo de 64 ▒bits▓ duplica el volumen de datos
  62. transferibles en un solo ciclo de reloj.  La cantidad de
  63. datos que se pueden transferir desde y hacia la memoria
  64. alcanza los 528 ▒Mbytes▓ por segundo.
  65.  
  66. Admite varios tipos de ciclos de bus, como el módo ráfaga que
  67. carga porciones de 256 bits en la caché en un solo ciclo de
  68. reloj.
  69.  
  70. Para acelerar aun más la velocidad del procesador se han
  71. cableado en el procesador algunas intrucciones de uso
  72. frecuente, como pueden ser MOV y ALU.
  73.  
  74. El precio de venta fijado por Intel es de 107000 pesetas para
  75. la versión a 60 MHz y de 118000 la versión a 66 MHz.
  76.  
  77.