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Text File  |  1993-01-11  |  1.3 KB  |  30 lines
  1. Further to the rhoumours of Acorn's next workstation.
  2. It has been said that it may have a 27 MIPS ARM.
  3. Well, I have one!
  4. Not a new machine, but a 27 MIPS ARM.  Inspired by
  5. Intel, Motorolla, IBM etc all working on more & more
  6. efficient pipelines in their processors I started 
  7. wondering exactly how usefull is a pipeline?
  8. The program I have written (armmips) shows what a
  9. pipeline can do, and don't get confused by the cache.
  10. In the program all instructions will be cached, so the
  11. difference between a small loop & a large one is entirely
  12. down to the pipeline.
  13. The ARM has a 3 instruction pipeline, fetch decode and
  14. execute all run simultaneously, until something like a
  15. branch or conditional opcode invalidate the next, already
  16. decoded, instruction (a pre-fetch abort).
  17. My ARM3 is clocked at a reliable 30MHz, this clock is twice
  18. the speed of the processor, so when my ARM is singing
  19. along at over 27.5 MIPS it is executing an average of about
  20. 1.8 instructions per cycle.  This is why it needs a cache
  21. to keep it fed with code at full speed.
  22. If anyone out there has one of the newer 35MHz ARM3's
  23. I'd love to know what that does.
  24. Note: This is a classic case of tweaking a benchmark
  25. for a particular processor to get the most favourable
  26. looking figures & is an ideal way to be smug to your
  27. collegues who have OverDrive486 cpu's!
  28.  
  29. Phill Rogers
  30. 8-)