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Text File  |  1987-08-26  |  3KB  |  88 lines
  1. Title    5-Bit Up Counter
  2. Pattern  UpCount.pds
  3. Revision B
  4. Author   Bill Karkula
  5. Company  Monolithic Memories Inc., Santa Clara, CA
  6. Date     8/1/86
  7.   
  8. CHIP UpCounter PAL20RA10
  9.   
  10. /PL D4 D3 D2 D1 D0 CK NC /LD /LR /RST GND
  11. /OE R0 R1 R2 R3 R4 Q0 Q1 Q2 Q3 Q4 VCC
  12.   
  13. EQUATIONS
  14.   
  15. /Q4             := Q4                   ;Toggle if lower MSB
  16. Q4.CLKF          = /Q3                  ;becomes a zero
  17. Q4.RSTF          = RST                  ;Rollover/master RST
  18. Q4.SETF          = D4*LD                ;Load initial Count
  19.   
  20. /Q3             := Q3                   ;Toggle when Q2
  21. Q3.CLKF         = /Q2                   ;becomes a zero
  22. Q3.RSTF         = RST                   ;Rollover/master RST
  23. Q3.SETF         = D3*LD                 ;Load initial count
  24.   
  25. /Q2             := Q2                   ;Toggle when Q1
  26. Q2.CLKF         = /Q1                   ;becomes a zero
  27. Q2.RSTF         = RST                   ;Rollover/master RST
  28. Q2.SETF         = D2*LD                 ;Load initial count
  29.   
  30. /Q1             := Q1                   ;Toggle when Q0
  31. Q1.CLKF         = /Q0                   ;becomes a zero
  32. Q1.RSTF         = RST                   ;Rollover/master RST
  33. Q1.SETF         = D1*LD                 ;Load initial count
  34.   
  35. /Q0             := Q0                   ;Toggle LSB
  36. Q0.CLKF         = CK                    ;External CLKF input
  37. Q0.RSTF         = RST                   ;Rollover/master RST
  38. Q0.SETF         = D0*LD                 ;Load initial count
  39.   
  40. /R4             := /D4                  ;Load rollover point
  41. R4.CLKF          = LR                   ;if /LR is low
  42. /R3             := /D3                  ;Load rollover bit 3
  43. R3.CLKF          = LR                   ;if /LR is asserted
  44. /R2             := /D2                  ;Load rollover bit 2
  45. R2.CLKF          = LR                   ;if /LR is asserted
  46. /R1             := /D1                  ;Load rollover bit 1
  47. R1.CLKF          = LR                   ;if /LR is asserted
  48. /R0             := /D0                  ;Load rollover bit 0
  49. R0.CLKF          = LR                   ;if /LR is asserted
  50.   
  51. SIMULATION
  52.   
  53. TRACE_ON PL OE CK Q0 Q1 Q2 Q3 Q4
  54.   
  55. SETF OE /PL /LR /RST /LD /CK            ;INITIALIZE OE AND PL
  56. SETF CK LD LR D0 D1 D2 D3 D4
  57.   
  58. SETF RST /LD                            ;Test SET function
  59.                                         ;of registers
  60. CHECK  Q0  Q1  Q2  Q3  Q4               ;Check for high
  61.                                         ;on reg. outputs
  62. SETF /RST                               ;Deassert SET funct
  63.   
  64. SETF D0 D1 D2 D3 D4 LD                  ;Test RESET function
  65. CHECK /Q0 /Q1 /Q2 /Q3 /Q4
  66.   
  67. SETF /OE Q4 Q3 Q2 Q1 /Q0 /LD            ;Disable RESET(LD=0)
  68.                                         ;load registers w/
  69.                                         ;HHHHL (Q4..Q0),
  70.                                         ;tristate registers
  71. SETF PL                                 ;Load reg.'s w/ data
  72.                                         ;on output bus.
  73. SETF OE /PL                             ;Disable PRELOAD &
  74.                                         ;TRISTATE funct.
  75. SETF CK
  76. SETF /CK
  77.   
  78. SETF CK
  79. SETF /CK
  80.   
  81. SETF CK
  82. SETF /CK
  83.   
  84. SETF CK
  85. SETF /CK
  86. TRACE_OFF
  87.   
  88.